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发表于 2006-12-8 20:00:41| 字数 2,836| - 中国–广东–湛江 电信
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让你的内存降频
没错,我没有打错汉字,是降频不是超频.这样做的是因为通常我们买的笔记本DDR内存频率是DDR333的,如果硬件超频的话,BIOS的软件会错误认为内存的频率还是在以前的频率上运行:
比如原来是跑133外频(DDR266)的内存,当你超频变为176(DDR353)的频率的时候,参数还是按照DDR266的设定来跑,那么怎么解决这个问题?
修改SPD的参数,使得DDR266的参数是按照DDR333的设定来跑就解决了.要记住频率越高,需要设定的延时就越大,把DDR266的时间参数按照DDR200的规格来设定,同样DDR333按照DDR266来设.如果你的内存是支持DDR400的就更好了,改为DDR333的时间规格就对了.
对于可以根据内存自动改变分频系数的主板,分频系数在3:4,3:5可以变.
通常CPU是100Mhz外频,如果是DDR266内存就工作在3:4状态.
如果是DDR333的内存就自动升为3:5.这样对DDR400的内存超频来说,难度更高了.记住X31,x32是不支持3:5的.
相关超频的文章请看
fay2003hiend的讯驰一二代平台笔记本硬超频全攻略
我的用setfsb给X31和X32的超频
还要感谢degoxin兄弟的400外频的PM超频成功的XD们进来看看
其它参考guryhwa的X31的超频
还有很多参考资料就不一一列举了
在这里,我要感谢Thaiphoon这个软件的作者,使我少了很多动手的麻烦,有了他的工作,才有我下面的文章.
要是象以前,恐怕要出动以下照片这些家伙了.
[img ]http://www.ibmnb.com/attachments/month_0404/spd_klwJ3tCJhPtr.jpg[/ img]
[img ]http://www.ibmnb.com/attachments/month_0404/spd2_pgFepWJfAzJC.jpg[ /img]
第一步当然是下载Thaiphoon这个软件,3.0版本才开始支持DDRII,我也没有DDR2的内存,就用2.0版本配合DDR内存为例子来说明.Thaiphoon目前支持的主板主要是nVidia nForce2/3/4, SiS 96x, Intel PIIX4/ICHx, VIA VT82Cxxx/VT82xx等.
在分析过多种内存之后发现,很多内存SPD内填的数据只写主流工作频率,就算是三星原装的内存条也是只写了DDR266和DDR333的设定.虽然它的芯片也可以在DDR200和DDR400上跑.对其它厂家的频率的设定就更多种多样了.
从技术上来说,我们只要看SPD内地址为0x12的数据,就知道可以工作在哪些频率下.
如果是写0x0C,表示只记录了CAS为2.5和2.0nS时的参数,通常对应于DDR266,DDR200;
如果是写0x18,表示只记录了CAS为3.0和2.5nS时的参数,通常对应于DDR400,DDR333;
如果是写0x1C,则表示记录了CAS为3.0,2.5和2.0nS时的参数,对应于DDR400,DDR333,DDR266;
如果你的内存是标示为DDR333的,你又想在X31,X32的机器上超频使用,最简单的办法就是把这个位置的数据改一下,就可以了,但是千万不要忘记了校验位也要改.开机用软件来测的话,就会看见你的内存被标识为DDR266的内存了.
但这样改还是有机会不行,原因还是按266的参数跑353是不行的.那么我们就要进一步修改数据了.
Cycle time at Max CAS Latency 在DDR266上是7.5 ns,在DDR400和333上是5.0 ns ,这个数据的位置是在0x09.(0x50-->0x75)
0x0A地址的SDRAM Access from Clock (tAC)由原来的0.65 ns 改为0.75nS.(0x65-->0x75)
0x17地址的Minimum Clock Cycle at tCL = X - 0.5: 由原来的6.0 ns 改为10.0nS.(0x60-->0xA0)
0x18地址的Max Data Access Time at tCL = X - 0.5 (tAC):由原来的 0.70 ns 改为0.75nS.(0x70-->0x75)
0x19地址的Minimum Clock Cycle at tCL = X - 1:由原来的7.5 ns 改为没有数据0x00.(0x75-->0x00)
0x1A地址的Max Data Access Time at CL = X - 1 (tAC):由原来的0.75 ns 改为没有数据0x00.(0x75-->0x00)
0x1E地址的Minimum Active to Precharge Time (tRAS):由原来的40.0 ns改为45.0nS.(0x28-->0x2D)
0x1D地址的Minimum RAS to CAS delay (tRCD): 由原来的14.0 ns 改为20.0nS.(0x38-->0x50)
0x1B地址的Minimum Row Precharge Time (tRP):由原来的14.0 ns改为20.0nS.(0x38-->0x50)
0x29H地址的Min Active to Active/Auto Refresh Time (tRC):由55.0 ns改为没有数据0.(0x37-->0x00)
0x2AH地址的Min Auto Ref to Active/Auto Refresh (tRFC):由70.0 ns改为没有数据0.(0x46-->0x00)
0x1CH地址的Min Row Active to Row Active delay (tRRD): 由10.0 ns改为15.0nS.(0x28-->0x3C)
0x20H地址的Addr and CMD Input Setup Time Before Clock:由0.60 ns改为0.90nS.(0x60-->0x90)
0x21H地址的Addr and CMD Input Hold Time After Clock:由0.60 ns改为0.90nS.(0x60-->0x90)
0x22H地址Data Input Setup Time Before Clock:由0.40ns改为0.50nS.(0x40-->0x50)
0x23H地址Data Input Hold Time After Clock:由0.40ns改为0.50nS.(0x40-->0x50)
0x2BH地址Device Max device cycle time (tCKmax):由8.0 ns 改为0.(0x20-->0x00)
0x2CH地址Max skew between DQS and DQ signals:由0.40 ns改为0.(0x28-->0x00)
0x2DH地址Max Read Data Hold Skew Factor:由0.50 ns改为0.(0x50-->0x00).
以上就是要修改的数据部分了.
[ 本帖最后由 ehua 于 2007-2-5 17:30 编辑 ] |
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